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aliases.Vlg
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Text File
|
1994-06-18
|
2KB
|
37 lines
# FILE: aliases.Vlg
#
# DESC: Aliases for Verilog mode
#
# LAST UPDATE: 01/06/93 5:31:40 AM
electricAlias-def ・Vlg ・Vlg ・Vlg
electricAlias-var Vlg bb "begin"
electricAlias-var Vlg eb "end"
electricAlias-var Vlg bc "//"
electricAlias-var Vlg ec ""
electricAlias-def ・Vlg ¥{ "、{bb}¥r¥t・¥r、{eb}・"
electricAlias-def ・Vlg fork "fork¥r¥t・¥rjoin¥r・"
electricAlias-def ・Vlg input "input ・;¥r・"
electricAlias-def ・Vlg inout "inout ・;¥r・"
electricAlias-def ・Vlg output "output ・;¥r・"
electricAlias-def ・Vlg wire "wire ・;¥r・"
electricAlias-def ・Vlg tri "tri ・;¥r・"
electricAlias-def ・Vlg reg "reg ・;¥r・"
electricAlias-def ・Vlg assign "assign ・ = ・;¥r・"
electricAlias-def ・Vlg module "、ヌaskalias {module name} NAMEネmodule 、{NAME} (・);¥r¥t・¥rendmodule、{bc} 、{NAME}、{ec}¥r¥r・"
electricAlias-def ・Vlg function "、ヌaskalias {function name} NAMEネfunction 、{NAME};¥r¥t・¥rendfunction、{bc} 、{NAME}、{ec}¥r¥r・"
electricAlias-def ・Vlg task "、ヌaskalias {task name} NAMEネtask 、{NAME};¥r¥t・¥rendtask、{bc} 、{NAME}、{ec}¥r¥r・"
electricAlias-def ・Vlg for "for (・;・;・) 、{bb}¥r¥t・¥r、{eb} 、{bc}for、{ec}・"
electricAlias-def ・Vlg while "while (・) 、{bb}¥r¥t・¥r、{eb} 、{bc}while、{ec}・"
electricAlias-def ・Vlg repeat "repeat (・) 、{bb}¥r¥t・¥r、{eb} 、{bc}repeat、{ec}・"
electricAlias-def ・Vlg forever "forever 、{bb}¥r¥t・¥r、{eb} 、{bc}forever、{ec}・"
electricAlias-def ・Vlg if "if (・) 、{bb}¥r¥t・¥r、{eb} 、{bc}if、{ec}・"
electricAlias-def ・Vlg initial "initial 、{bb}¥r¥t・¥r、{eb} 、{bc}initial、{ec}・"
electricAlias-def ・Vlg always "always 、{bb}¥r¥t・¥r、{eb} 、{bc}always、{ec}・"
electricAlias-def ・Vlg elseif "¥b、{eb} else if (・) 、{bb}¥r・"
electricAlias-def ・Vlg else "¥b、{eb} else 、{bb}¥r・"
electricAlias-def ・Vlg case "case (・)¥r¥t・¥rendcase・"
electricAlias-def ・Vlg casex "casex (・)¥r¥t・¥rendcase・"
electricAlias-def ・Vlg casez "casez (・)¥r¥t・¥rendcase・"